蔵書情報
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書誌情報サマリ
| 書名 |
SystemVerilogによるモデリングと論理合成
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| 著者名 |
篠塚 一也/著
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| 出版者 |
共立出版
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| 出版年月 |
2026.1 |
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資料情報
各蔵書資料に関する詳細情報です。
| No. |
所蔵館 |
配架場所 |
資料番号 |
資料種別 |
請求記号 |
帯出区分 |
状態 |
所蔵棚番号 |
AJ区分
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取込区分
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| 1 |
中央 | 2F技術産業 | 1027141934 | 図書 | 549.7// | | 在庫 | 2F_R32A | 一般書(A) | |
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書誌詳細
この資料の書誌詳細情報です。
| タイトルコード |
1002000096594 |
| 書誌種別 |
図書 |
| 書名 |
SystemVerilogによるモデリングと論理合成 |
| 書名ヨミ |
システム ヴェリログ ニ ヨル モデリング ト ロンリ ゴウセイ |
| 副書名 |
ハードウェア記述言語による回路設計の基礎 |
| 副書名ヨミ |
ハードウェア キジュツ ゲンゴ ニ ヨル カイロ セッケイ ノ キソ |
| 著者名 |
篠塚 一也/著
|
| 出版者 |
共立出版
|
| 出版年月 |
2026.1 |
| ページ |
12,227p |
| 大きさ |
26cm |
| ISBN |
4-320-12592-6 |
| 分類記号 |
549.7
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| 著者紹介 |
名古屋大学理学研究科数学研究生修了。自社アートグラフィックスのEDA製品開発を担当。著書に「実践UVM入門」など。 |
| 内容紹介 |
ハードウェア記述言語としてSystemVerilogを採用し、回路設計をするために必要な基礎知識と基礎技術を解説する。SystemVerilogによる適切なRTL表現を準備する習慣が自然と身に付くテキスト。 |
目次
内容細目
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