蔵書情報
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書誌情報サマリ
書名 |
SystemVerilogによるFPGA/ディジタル回路設計入門
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著者名 |
小林 和淑/監修
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出版者 |
オーム社
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出版年月 |
2023.11 |
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資料情報
各蔵書資料に関する詳細情報です。
No. |
所蔵館 |
配架場所 |
資料番号 |
資料種別 |
請求記号 |
帯出区分 |
状態 |
所蔵棚番号 |
AJ区分
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取込区分
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在架
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1 |
中央 | 2F技術産業 | 1026656015 | 図書 | 549.1// | | 在庫 | R31B,R41 | 一般書(A) | |
○ |
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小林 和淑 小林 和淑 寺澤 真一 吉河 武文 塩見 準 門本 淳一郎
書誌詳細
この資料の書誌詳細情報です。
タイトルコード |
1000015449226 |
書誌種別 |
図書 |
書名 |
SystemVerilogによるFPGA/ディジタル回路設計入門 |
書名ヨミ |
システム ヴェリログ ニ ヨル エフピージーエー ディジタル カイロ セッケイ ニュウモン |
著者名 |
小林 和淑/監修
小林 和淑/共著
寺澤 真一/共著
吉河 武文/共著
塩見 準/共著
門本 淳一郎/共著
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著者名ヨミ |
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出版者 |
オーム社
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出版年月 |
2023.11 |
ページ |
8,183p |
大きさ |
24cm |
ISBN |
4-274-23101-8 |
分類記号 |
549.7
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内容紹介 |
HDLは、高い抽象度でハードウェアの動作を記述することを目的に開発された。順序同期回路をSystemVerilogで記述し、LSIやFPGAに実装したい設計者向けに、設計事例をもとに解説する。 |
目次
内容細目
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